寫入操作時降低電源電壓之雙埠靜態隨機存取記憶體(SRAM) DUAL PORT SRAM HAVING A LOWER POWER VOLTAGE IN WRITING OPERATION

[[abstract]]本創作提出一種寫入操作時降低電源電壓之雙埠(Dual port)SRAM，其係包括一記憶體陣列，該記憶體陣列係由複數列記憶體晶胞與複數行記憶體晶胞所組成，每一列記憶體晶胞與每一行記憶體晶胞各包括有複數個記憶體晶胞(1)；複數個第一偏壓電路(2)，每一列記憶體晶胞設置一個第一偏壓電路(2)；以及一第二偏壓電路(3)。該等記憶體晶胞(1)係連接在一高電壓節點(VH)與一低電壓節點(VL)之間，該等第一偏壓電路(2)於對應之一寫入用字元線(WWL)為代表選定寫入狀態之邏輯高位準時，將一低電源供應電壓(LVDD)供應至該高電壓節點(VH)，俾藉由寫入操作時降低電源電壓以有效避免寫入邏輯1相當困難之問題；而於待機模式(standby mode)時，則藉由將該低電源供應電壓(LVDD)供應至該高電壓節點(VH)以及將較接地電壓為高之一電壓供應至該低電壓節點(VL)，以有效降低靜態隨機存取記憶體之功率消耗。結果，本創作所提出之寫入操作時降低電源電壓之雙埠SRAM，不但可有效避免習知具單一位元線之雙埠SRAM所存在寫入邏輯1相當困難之問題，並且也能兼具待機模式時降低漏電流之功效