Contribution à la synchronisation d'un convertisseur DC/DC abaisseur de tension de type buck

Les téléphones et tablettes de dernière génération embarquent une puissance de calcul numérique très importante nécessitant une puissance électrique d’alimentation toute aussi significative. Afin de réduire la consommation énergétique des composants numériques complexes des terminaux mobiles, des techniques de modulation dynamique de la tension d’alimentation et de la fréquence de fonctionnement du cœur de calcul numérique sont utilisées. Le convertisseur DC/DC qui assure l’alimentation du cœur numérique doit donc faire face à de forts transitoires de charge, de tension de référence et de tension de source. Le contrôle en mode glissant d’un convertisseur DC/DC permet un bon compromis entre les performances transitoires du convertisseur, la réalisation via des composants analogiques et la puissance dissipée par le contrôleur. C’est pourquoi ce type de contrôle apparait être adapté au contrôle de convertisseurs DC/DC alimentant des cœurs numériques. Cette thèse a pour objet l’étude des alimentations sur carte électronique où le contrôleur et l’étage de puissance sont intégrés sur puce tandis que les composants de puissance passifs sont montés sur le circuit imprimé. Le contrôle en mode glissant à fréquence de découpage fixe d’un convertisseur DC/DC a été démontré avec des résultats significatifs. Cependant les performances transitoires d’un tel convertisseur sont amoindries en raison des délais introduits par une fréquence de découpage fixe. Une nouvelle structure de régulation de fréquence de découpage d’un convertisseur DC/DC contrôlé en mode glissant est proposée dans cette thèse. Cette structure régule la fréquence de découpage moyenne du convertisseur tout en maintenant la réponse transitoire du convertisseur asynchrone par rapport à l’horloge de référence. Une analyse de stabilité qui prend en compte les spécificités d’un tel système est aussi proposée. Le convertisseur a été conçu sur un procédé CMOS 130nm de STMicroelectronics. La fréquence de découpage est maintenue volontairement faible pour conserver un rendement élevé avec des composants passifs externes. Le prototype présente un rendement supérieur à 80% entre 2.4mW et 960mW de puissance de sortie.Mobile applications necessitate nowadays huge digital-resources. Power management of a digital System-On-Chip (SOC) is based on dynamic voltage scaling. DC/DC converters used to supply the digital SoCs are facing stringent constraints with respect to load-transients, line-transients and reference tracking. Hysteretic control is known as the most convenient control scheme with a fair trade-off between transient performances, analog implementation and power consumption, particularly for one-phase architecture. The thesis focuses on-board DC/DC with a significant constraint on footprint (i.e. on components count and values). Fixed switching-frequency hysteretic control has been experimented with significant results. Transient performances are reduced due to latency introduced in the switching frequency control. The present study focuses on the improvement of the concept as well as its implementation and the analysis of stability. A new analog implementation of the sliding-mode control is presented with switching-frequency control using a particular analog phase-locked-loop but preserve transient performances. The DC/DC converter is implemented in CMOS 130nm by STMicroelectronics. The switching frequency range has been voluntarily limited and excludes the possible integration of passive components for the sake of silicon access. A hybrid demonstrator is presented with efficiency higher than 80\% between 2.4 mW and 960 mW output power